L’organisation à but non lucratif Open Compute Project Foundation (OCP), créée pour rendre accessibles à tous les innovations hyperscale. A annoncé cette semaine une nouvelle collaboration avec la JEDEC Solid State Technology Association pour établir un cadre pour le transfert de technologie capturée dans une spécification approuvée par l’OCP vers JEDEC pour inclusion dans l’une de ses normes.
Cliff Grossner, Ph.D., vice-président de l’intelligence du marché et de l’innovation à l’Open Compute Project Foundation.
“L’un des principaux efforts de l’OCP est centré sur le besoin de calculs spécialisés pour l’IA et le ML charges de travail entraînant le besoin de silicium spécialisé. Pour répondre au besoin de silicium spécialisé tout en permettant un rythme d’innovation rapide, nous pensons qu’une nouvelle économie ouverte de Chiplet avec une faible barrière à l’entrée est nécessaire et nécessitera une collaboration et des normalisations sur plusieurs dimensions, garantissant que les entreprises peuvent interagir dans un ouverte de manière efficace et évolutive. L’OCP investit depuis plusieurs années dans le rôle de catalyseur d’une économie chiplet ouverte par le biais de son projet Open Domain Specific Architecture (ODSA) et est heureux d’établir cette alliance avec JEDEC pour permettre au travail effectué dans ODSA de faire partie d’une norme internationale mondiale. qui fait progresser l’industrie », a déclaré
Open Compute Project Foundation
« Dans le cadre de cette nouvelle alliance, l’effort actuel consistera à fournir un mécanisme pour standardiser Chiplet descriptions de pièces tirant parti de la spécification OCP Chiplet Data Extensible Markup Language (CDXML) pour faire partie de JEDEC JEP30 : Part Model Guidelines à utiliser avec les outils EDA d’aujourd’hui. Avec cette norme JEDEC mise à jour, qui devrait être publiée en 2023, les constructeurs de Chiplets seront en mesure de fournir électroniquement une description normalisée des pièces de Chiplet à leurs clients, ouvrant la voie à l’automatisation de la conception et de la construction de System in Package (SiP) à l’aide de Chiplets. La description comprendra les informations nécessaires aux constructeurs de SiP, telles que les propriétés thermiques du Chiplet, les exigences physiques et mécaniques, les spécifications de comportement, les propriétés d’intégrité de l’alimentation et du signal, le test du Chiplet dans le package et les paramètres de sécurité.
Tom Hackenberg, analyste principal, Computing & Software Semiconductor, Memory and Computing Division, Yole Group
“La chaîne d’approvisionnement du silicium est diversifiée. Il doit desservir de nombreux segments d’équipements électroniques verticaux, notamment l’automobile, le traitement des données personnelles, les centres de données et le traitement des données d’entreprise, les communications et les infrastructures, le médical, la défense, l’aérospatiale et l’industrie. Chaque marché comprend une valeur différente et des exigences spécifiques à l’application qui doivent être satisfaites. Les fournisseurs de processeurs se sont tournés vers des plates-formes de puces très hétérogènes pour rester compétitifs.
Cette approche devient de plus en plus complexe et coûteuse à fabriquer. En réponse à ces défis, les constructeurs de puces ont commencé à adopter l’utilisation de puces. Cependant, la même diversité qui a créé la demande de chiplets rend également peu probable qu’un seul fournisseur possède la vaste expertise nécessaire pour desservir tous ces marchés.
Ainsi, de nombreuses chaînes d’approvisionnement Chiplet différentes émergeront et aucune solution ne servira tous les marchés. Le marché émergent autour des Chiplets aura besoin de nombreux acteurs et d’une faible barrière à l’entrée permettant une innovation rapide. Des communautés ouvertes partageant l’effort de création d’outils communs, de prototypes, de workflows commerciaux et de normalisations sont essentielles pour accélérer une économie de puces.
Source : TPU
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